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Gowin EDA(FPGA Designer)是一款功能强大的集成电路设计和验证工具，它是专门为高云半导体FPGA芯片设计的配套程序，提供易于使用的集成设计环境，从FPGA设计输入、代码合成、布局和路由、bitsteam生成到板上的GOWIN FPGA上下载，全面优化设计，改进方案和整个设计流程，集成内部Gowin合成，用于前端设计综合，支持创建RTL和后期合成，合成后输入文件是由用户RTL生成的网表文件，用户所需的综合和约束文件。集成IP核生成器以及用于即时分析信号设计的在线调试工具Gowin分析示波器（GAO）！获得更强大的性能，更具优势的任务流程，减少工作中的风险和直面挑战！
软件特色
1、完整的基于 GUI 的环境，从 FPGA 设计输入、代码合成、布局和路由、bitsteam 生成到板上的 GOWIN FPGA 上下载。
2、集成内部Gowin合成，用于前端设计综合
3、支持创建 RTL 和后期合成。
RTL 输入文件是符合硬件说明的 RTL 文件
4、用户所需的语言和约束文件;
合成后输入文件是由用户RTL生成的网表文件
5、用户所需的综合和约束文件。
6、集成 IP 核生成器
7、在线调试工具 Gowin 分析示波器 （GAO），用于即时分析信号设计
系统要求
操作系统： Windows 7、8、10 或 11（64 位）
处理器 双核 CPU 或更高
内存 4GB 内存或更大
存储：2GB 可用硬盘空间
显卡 兼容 DirectX 9 的显卡
安装激活教程
1、解压后安装包如图所示
2、双击Gowin_V1.9.9Beta-4_win.exe安装程序，许可协议点击i agree
3、安装文件夹
4、安装完成，运行gwlicgen生成lic文件，复制到安装目录中
5、运行软件，选择你的lic文件，点击save后验证
主要特点
1、一体化设计
-设计可分阶段完成，也可一揽子自动完成
-可选择命令行模式或图形交互模式完成设计
-利用脚本设计，可灵活地设计任何单一模块而不影响一体化设计全程
2、优化设计
-网表优化设计
-快速时序优化分析和设计
-资源分析和优化
3、分层设计和分析
-支持分层网表结构输入和输出
-同时支持扁平化网表结构输入和输出
-分层图形显示、追踪、分析网表
4、方便灵活的交互图形设计
-用户界面简单清晰
-包含项目、设计模块、工具和输出部分
-设计约束输入、选择和更新
-快速时序分析和报告
-Push button设计技术
使用帮助
新建工程
1、新建工程
单击“File > New…”，打开“New”对话框，如图所示。
注！
也可通过以下三种方式打开“New”对话框：
? 使用快捷键 Ctrl+N；
? 单击工具栏上“New File or Project”图标；
? 单击 Start Page 窗口上“Quick Start > New Project”。
2. 打开“New”对话框后默认已选择“FPGA Design Project”，单击“OK”，打开“Project Wizard”对话框
3. 创建工程名和路径，如图所示：
a) 在“Name”文本框中输入工程名；
b) 单击“ ”选择工程路径。
若选中“Use as default project location”，即会将该工程路径设置为默认路径，下次新建工程时会默认创建在该路径。
注！
? Windows 和 Linux 下的文件路径长度均有限制，Windows 系统路径长度限制 260个字符，Linux 系统限制 4096 个字符。在路径下存在文件长度超出系统限制的情况下，删除或者拷贝路径都会失败；
? 与 Linux 不同，在 Windows 中路径分隔符为“\”，如 E:\Gowin\ide。
4. 单击“Next”，设置 FPGA 的器件信息，共有五个过滤选项 Series、Device、Package、Speed 和 Device Version。
? 在 Series 中过滤芯片系列
? 在 Device 中过滤器件
? 在 Package 中过滤封装类型
? 在 Speed 中过滤速度等级
? 在 Device Version 中过滤器件的版本
? 在“Part Number”栏中选择芯片型号，并且该栏中会显示所选择器件的详细资源信息。对于没有 Device Version 的器件，版本信息栏显示为空，对于同一器件的 Device Version 以倒叙显示，如图所示。
5. 单击“Next”，在 Summary 中核对新建 FPGA 工程的工程信息及器件信息，如图所示。
6.单击“Finish”，工程创建完成。
2、打开工程
用户可直接通过云源界面打开已创建的高云软件工程，有以下五种方式打开工程：
工具栏打开
1. 单击工具栏上的“ ”图标，打开“Open File”对话框，如图所示；
2. 选择工程文件*.gprj，单击“Open”，打开工程。
菜单栏打开
1. 菜单栏中，选择“File > Open …”打开“Open File”对话框
2. 选择工程文件*.gprj，单击“Open”，打开工程。
Start Page 打开
1. 在“Start Page”页面中，单击“ ”，打开“Open Project”对话框；
2. 选择工程文件*.gprj，单击“Open”，打开工程。
Recent Projects 打开
菜单栏中，单击“File > Recent Projects”，选择需打开的工程。
注！
? 亦可在“Start Page > Recent Projects”列表中，选择需打开的工程；
? “Recent Projects”为最近打开过的工程列表，最多会保留 10 个工程；
? 若该工程已被删除，会弹出“Open Project”提示框，提示找不到指定路径。
工程文件打开
双击工程文件*.gprj，自动使用最近一次安装的云源打开该工程。
3、编辑工程
新建或打开工程后，可在工程管理窗口对 FPGA 工程器件信息及相关文件等进行编辑，如图所示。
工程管理区主要包含以下信息：
? FPGA 工程的路径信息；
? 使用的芯片型号；
? 当前工程包含的文件信息，包括用户设计文件（Source Files）、约束文件和配置文件。其中，约束文件包括物理约束文件（.cst）、时序约束文件（.sdc），配置文件包括 GAO 配置文件（.gao、.rao）、功耗分析配置文件（.gpa）等。
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其它版本
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